九霜迟 的个人主页

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九霜迟

湖北大学 集成电路学院 · 微电子科学与工程 · 2025 级。
折腾 Verilog、单片机和写不完的代码,顺便记录一下日子。 关于我 →

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用 Next.js + FastAPI 搭一个前后端分离的高颜值博客

从零手写一套全栈:前端 App Router + Tailwind,后端 SQLModel + PostgreSQL,毛玻璃 UI、深色模式、说说便签、照片墙全都自己实现。

从与非门到五级流水:手写一个 RISC-V CPU

Verilog 入门:锁存器与触发器那点事

用 Python 跑工艺:把版图良率算明白

说说

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记录生活中的小确幸

17 小时前

今天 RTL 仿真终于跑通了,流水级全对。那一刻宿舍的灯都亮了 ✨

2 天前

用 FastAPI 重写了博客后端,SQLModel 把 schema 和 model 合成一个类,写起来真爽。

4 天前

图书馆四楼靠窗的位置,夕阳刚好打在键盘上,敲了一下午的约束文件。

照片墙

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校园的黄昏
实验室的电路板
窗边的云
夜里的城市

时光河流

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横向拖拽,看时间从指尖流过

2025.09第一篇博客 2025.11焊第一个电路 2026.01拿到第一台示波器 2026.03期末设计答辩 2026.06写了第一个 CPU 2026.10博客重写成这样

关于

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你好呀,我是九霜迟,湖北大学集成电路学院微电子科学与工程专业 2025 级学生,一个还在跟 Verilog 和位运算较劲的本科生。

写代码是我的日常:单片机、FPGA、Python 脚本、偶尔写点前端。这个博客是我给自己留的一个角落,用来放技术笔记,也用来放那些没什么用但舍不得删的东西。

如果你也在啃数字电路,或者只是想找点能抄的代码,随时来敲门 👋

  • 专业微电子科学与工程
  • 院校湖北大学
  • 年级2025 级
  • 方向数字 IC / RTL 设计
  • 语言Verilog · Python · TS
  • 坐标武汉